AI-Driven Manufacturing covers the process and device physics. AI-Driven Design covers the EDA tools, IP, verification and enablement.
Multiphysics from simulation to the fab floor
EDA tools, licensed IP, verification and enablement
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Process and device physics, from simulation to the fab floor
作図中に設計ルールを検証するアナログレイアウト。10 GBを超える設計も数分で開けます。
Expertは、アナログ、RF、ミックスドシグナル、デジタル設計向けのSilvacoの階層型ICレイアウトエディタです。任意の角度で作図できます。編集中に設計ルールを検証するため、間隔エラーはサインオフ時ではなく、まだポリゴンを移動できる段階で分かります。LinuxとWindowsで動作します。
最もコストがかかるレイアウトエラーは、完成したように見えた後で発見されるものです。Expertは編集中にルールチェックと接続性チェックを実行します。
インターフェース、ホットキー、ツールバーをチームの作業方法に合わせて設定できます。繰り返す操作をスクリプト化し、プロジェクト全員でライブラリを共有できます。階層内でセルをその場で編集したり、展開したり、フラット化したデータを扱ったりでき、必要な数のウィンドウで作業できます。
数百万トランジスタ規模の設計も、一般的なワークステーションで高速に読み込み、パン、ズームできます。
DRC Assistは、各編集操作で有効にしたルールを検証します。違反を測定値とともに示すため、その場で修正できます。配線の作図中には、その配線の抵抗を表示します。
任意の形状をクリックすると、Node Probingが電気的に接続されたすべての要素を強調表示します。短絡箇所特定機能は、電源とグランド間の短絡を追跡します。エディタを離れずに、2つのレイアウトを比較し、SmartDRC/LVSのエラーを確認できます。
ネットリストからレイアウトを生成し、各バリエーションを手作業で作図する代わりに、JavaScriptまたはSilvacoのLISAスクリプト言語でパラメータ化セルを構築できます。
任意角度のルーラーにより非マンハッタン形状でも正確に測定でき、等抵抗配線はTFTとフラットパネルの配線に対応します。
ExpertはCMOS、BiCMOS、GaAsなどのプロセスに対応します。カスタムPDKまたはiPDKから開始し、評価前にファウンドリのPDKをご確認ください。
すでにVirtuosoを使用している場合は、その情報を基にテクノロジーファイルを設定できます。
ExpertはGDSII、LEF/DEF、DXF、OASIS、CIF、Applicon、OpenAccessデータベース、.eld、.sldの読み書きに対応します。
暗号化により、自社IPと第三者からライセンスを受けたIPを、レイアウト内で保護します。
レイアウトは回路図とサインオフの間に位置するため、前後のツールもエディタと同じくらい重要です。
回路図、ネットリスト、既存のレイアウトデータベース。
Gateway:回路図とレイアウト間のクロスプローブに対応する回路図駆動レイアウト
ネットリスト駆動レイアウト用のネットリスト
既存のGDSIIデータベース、またはOASIS、LEF/DEF、OpenAccessデータ
Silvacoの検証・抽出ツールと、他社ツールによるサインオフ向けのCalibre。
SmartDRC/LVS:物理検証。Expert内でエラーを確認できます
Hipex:寄生素子抽出。回路図ネットリストにバックアノテートします
Victory RCx: 製造分野の3DフィールドソルバーによるRC抽出。そのソルバーはExpert内でもHipex-FSとして動作します
CalibreでサインオフDRCとLVSを実行する場合の、Calibre Interactive、Calibre RealTime、Calibre RVE
7から180 nmのプロセスで量産IPを提供する、アナログ・ミックスドシグナルIPサプライヤーです。同社の最先端FinFET設計フローでは、Gateway、SmartViewとともにExpertを使用しています。
「Expertの柔軟なスクリプト機能など、Silvacoのカスタム機能を活用しました。今後の設計でもSilvaco製品を使用し、次世代プロセス技術への挑戦を続けています。」Randy Caplan、Silicon Creations共同創業者
データシート:編集機能と任意角度機能、処理容量、回路図駆動レイアウト、Pcell、およびCalibre、Virtuosoデータ、Hipexとの連携。
DRC Assist、Node Probing、レイアウト比較、Gateway・SmartDRC・Hipex・Victory RCxとの統合、フラットパネル機能、断面ビューア。
ExpertからバッチまたはCalibre Interactive経由でCalibre DRCとLVSを起動し、エラーをレイアウト上で強調表示します。
回路図からレイアウトへネット情報を渡せるよう、Gatewayからのネットリスト駆動レイアウトに向けて独自のスタンダードセルレイアウトを準備します。
ExpertのOAモードにおけるOpenAccess Pcell:付属のPyCell評価器と、代わりにPDKが要求する評価器を使用する方法。
アナログレイアウトの評価を左右する疑問をお寄せください。GDSIIやOpenAccessデータを正しく開けるか。Virtuosoのテクノロジー設定を引き継げるか。利用するファウンドリとノードにはどのPDKが対応するか。まず当社エンジニアにご相談ください。
ICレイアウトエディタは、トランジスタ、配線、コンタクトとなる各マスク層の形状、すなわちチップの物理形状を作図するツールです。アナログレイアウトでは、設計ルールや寄生成分の影響が現れ始める場でもあります。SilvacoのExpertは、階層型で任意角度に対応するレイアウトエディタであり、アナログ、ミックスドシグナル、RF回路に加えてデジタルブロックにも使用されます。
はい。既存のVirtuoso情報があれば、それを基にExpertのテクノロジーファイルを構築し、レイヤー、色、塗りつぶしパターン、ホットキー、マクロ、ツールバーを直接インポートできます。レイヤーマップを手作業で作り直す必要がなく、レイアウト設計者は慣れた環境で作業を開始できます。
ExpertはGDSII、OASIS、OpenAccess、LEF/DEF、CIF、DXF、Appliconに加え、.eldと.sld形式の読み書きに対応し、OpenAccess iPDKをサポートします。ネットリスト、またはクロスプローブ用のリンクを維持するGatewayの回路図からレイアウトを開始することもできます。
インタラクティブDRCは、後で別途実行するのではなく、レイアウトの作図中に設計ルールを検証します。ExpertのDRC Assistはテクノロジーファイルからルールを取得し、各違反を根拠となる数値とともに報告します。階層内の下位セルにある形状も認識するため、次の作業に進む前にエラーを修正できます。
はい。Expert内から、バッチジョブまたはCalibre Interactive経由でCalibre DRCとLVSを起動し、Calibre RVEから各エラーをレイアウト上で強調表示できます。Calibre RealTimeにより、必要に応じてサインオフ品質のDRCを実行できます。ただしCalibreインターフェースはLinuxのみで利用できます。
はい。PcellはJavaScriptまたはSilvaco独自のスクリプト言語LISAで記述できます。Expertのネットリスト駆動・回路図駆動レイアウトにも利用されます。OpenAccessモードでは、PythonベースのPyCell用の付属評価器、またはPDKが指定する評価器を使い、OpenAccess Pcellも実行できます。
Expertの回路図駆動レイアウトの基となる回路図を作成
回路図からサインオフまでの全フローと、それに含まれる全9製品。