실바코의 아날로그 커스텀 디자인 플로우

2020년 12월 18일 | 3:00am-3:30am (한국 시각) 실바코의 아날로그 커스텀 디자인 솔루션에 대해 설명하고, 2020년 버전에서 상호 운용성, 성능, 생산성이 어떻게 향상되었는지 살펴봅니다.

Customer Interview: Why I Rely on SmartSpice

Martin Mallinson is an experienced analog circuit designer with multiple patents. Over his 40-year career, his audio designs have been used in millions of smartphones.  Martin spoke with Graham Bell about why SmartSpice is different from other analog simulators and how he relies on its interactivity, speed, and precision for his analog design work.

SmartSpice HPP로 40배 더 빠른 시뮬레이션

2020년 11월 18일 | 3:00am-3:30am (한국 시각) 파티션 기반 시뮬레이션을 채택함으로써 SmartSpice HPP가 아날로그 회로의 과도 시뮬레이션의 모든 내부 측면을 가속화하기 위해 현대의 멀티코어 하드웨어 플랫폼을 어떻게 활용하는지 살펴 봅니다.

Improvement of Parasitic Capacitance Extraction Rules for Large-Scale Layout and Its Accuracy Verification Method

September 17, 2020 | 13:00 – 13:30 (JST) The accuracy of rule-based full-chip parasitic capacitance extraction tools including Silvaco's Hipex is highly dependent on the description of the rule files.

Leti-NSP 모델을 이용한 수직 적층 나노시트의 Utmost IV 모델 추출 플로우

2020년 7월 31일 | 2:00am-2:30am (한국 시각) Leti-NSP 모델을 기반으로 수직 적층 나노시트에 대한 파라미터 추출 방법을 제시합니다.

SmartSpice 컴팩트 모델 활용

2020년 6월 12일 | 2:00am-2:30am (한국 시각) 최적의 시뮬레이션 성능을 얻기 위해 SmartSpice에서 컴팩트 모델을 개발하는 방법을 안내합니다. 사용자 지정 Verilog-A 모델을 구성할 때 SmartSpice에서 모델을 사용하는 방법과 모범 사례에 대해 알아봅니다.

EDA 분야에서의 머신 러닝 – 20년에 걸친 노력

2020년 6월 26일 | 2:00am-2:30am (한국 시각) 새로운 접근 방식과 다른 애플리케이션에 적용되는 방식을 검토합니다. 실바코의 머신 러닝 기반 EDA 툴의 예제를 제시하고 그 결과를 보여 줍니다.

Utmost IV를 이용하여 TFT 및 OLED에 대해 SPICE 모델링

2020년 5월 15일 | 2:00am-2:300am (한국 시각) 실바코의 Utmost IV 모델링 소프트웨어를 사용하여 FPD 애플리케이션과 관련된 SPICE 모델링 접근 방식 및 방법에 대해 알아봅니다. 주파수 분산 효과와 같은 문제를 중심으로, TFT 소자 모델링, Verilog-A 모델 및 매크로모델 사용 등 OLED 소자의 모델링 등을 논의할 것입니다.

Utmost IV Quick-Start 모델 최적화 템플릿

2020년 3월 13일 | 2:00am-2:30am (한국 시각) UTMOST IV: Quick-Start Optimization Templates에서 사용할 수 있는 새로운 기능을 소개합니다. 이 기능은 사용자가 데이터를 기반으로 특정 모델에 대한 최적화 프로젝트를 신속하게 생성할 수 있는 기능입니다. 따라서 SPICE 모델링 경험이 거의 없더라도, 사용자의 생산성을 크게 향상시킬 수 있습니다.